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Verification Methodology Manual (VMM)

Inhalt
Was ist VMM?
Qualifikation und Erfahrung von Doulos im Bereich VMM
Doulos Trainings programme zu VMM
Kundensupport

Was ist VMM?

Mit der Verifikationsmethode VMM für SystemVerilog können Entwickler leistungsstarke und robuste Verifikationsumgebungen für komplexe elektronische Systeme und IP erstellen. IP nach VMM-Vorgaben lässt sich mühelos mittels "Plug & Play" in VMM-Testbenches einsetzen. Entwickler, die über Erfahrung mit VMM verfügen, können Verifikationsumgebungen rasch erstellen oder erweitern, ohne sich dafür erst langwierig in eine Nicht-Standardmethode einzuarbeiten oder eigene Methoden zu entwickeln.

Definiert ist VMM im "Verification Methodology Manual (VMM) for SystemVerilog", einem von führenden Verifikationsexperten bei ARM Ltd. und Synopsys Inc. gemeinsam herausgegebenen Fachbuch. VMM beinhaltet breit gefächerte Regeln und Empfehlungen zur Entwicklung von Testbenches und Testsuites, zum Einsatz von Assertions für Verifikationszwecke, zur Verwendung von Legacy-Testbenchcode und für eine systemweit einheitliche Verifikationsstrategie.

Im Mai 2008 stiftete Synopsys seine gesamte VMM-Implementierung Accellera mit dem Ziel, die Verifikationsinteroperabilität zu standardisieren.

Qualifikation und Erfahrung von Doulos im Bereich VMM

Doulos ist seit der Veröffentlichung 2005 im Bereich der VMM-basierten Verifikation aktiv und bietet bereits seit 2004 Schulungen und Kundensupport zu SystemVerilog an. Das Engagement von Doulos umfasste unter anderem die Kooperation mit führenden Entwicklern von Verifikationsmethoden bei Synopsys, der es zu verdanken ist, dass Doulos 2007 das weltweit erste unabhängige VMM-Training auf den Markt bringen konnte.

Die aktuelle Version dieses Kurses, VMM Adopter Class, ist zentraler Bestandteil des Doulos Programms SystemVerilog out of the Box™ und gliedert sich nahtlos in den Doulos Katalog zu Trainings und Supportkomponenten für SystemVerilog ein. Mehr >>

Doulos hat seit 2004 quer über alle Branchensegmente und Tools einen großen Erfahrungsschatz zu VMM und SystemVerilog angesammelt. Ein Teil dieses Know-hows floss 2006 in den VMM Companion Guide ein, der hier>> zum Download bereitsteht.

Darüber hinaus hat Doulos mehrere preisgekrönte Artikel über VMM auf der DVCon und in aufeinanderfolgenden Synopsys User Groups vorgestellt und damit maßgeblich zur Verbreitung von aktuellem Know-how zu VMM beigetragen. Ein Teil davon steht hier>> für Sie bereit.

Doulos Trainings programme zu VMM

VMM Adopter Class
Dieser 2-tägige Kurs liefert eine schnelle, praxisbezogene Einführung in die Grundsätze der Verifikation und die intensive praktische Anwendung von VMM mit Synopsys VCS™. Als Bestandteil des Doulos Programms SystemVerilog out of the Box™ lässt sich der Kurs mit Komponenten von Modular SystemVerilog, flexiblen Optionen zum Projektsupport und ergänzenden Trainings zu speziellen Einzel-Tools in Kooperation mit Synopsys kombinieren und bedarfsgerecht anpassen. Auf diese Weise werden die Teilnehmer gründlich auf den Einsatz von SystemVerilog-basierten Verifikationsprojekten vorbereitet.

Die klassenbasierte Verifikation mit SystemVerilog ist zentraler Bestandteil der VMM-Lernkurve. Wird dieses Thema schlecht vermittelt oder von den Entwicklern nicht ausreichend verstanden, wird die Aneignung und Anwendung von VMM unnötig erschwert. Die sorgfältige Bearbeitung dieses oft als besonders schwierig geltenden Themas im Rahmen des Vorbereitungskurses Comprehensive SystemVerilog legt damit bereits den Grundstein für den Erfolg vieler Kunden.
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Comprehensive SystemVerilog
Diese Komplettlösung erfüllt die Anforderungen von Design- und Verifikationsgruppen. Neben objektiven und aktuellen Erläuterungen der beiden bekanntesten veröffentlichten Ansätze zur Verifikationsmethodik lernen die Teilnehmer die wichtigsten unterstützenden Funktionen und Merkmale der Sprache SystemVerilog kennen. Mehr >>
Modular SystemVerilog
Modular SystemVerilog besteht aus mehreren Modulen, die sich je nach Trainingsanforderungen des Teams zu einem integrierten Trainingsprogramm kombinieren und anpassen lassen:
- Fast-track Verilog for VHDL Users
- Fundamentals of SystemVerilog for Design
- Fundamentals of SystemVerilog for Verification
- SystemVerilog Assertions
- Module-based SystemVerilog Verification
- Class-based SystemVerilog Verification
- Verification Methodology Adopter Classes
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Kundensupport

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